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基于FPGA的数字频率计设计
摘要：在电子技术中，频率是最基本的参数之一，并且与许多电参量的测量方案、测量结果都有十分密切的关系，因此频率的测量就显得更加重要。通过运用Verilog HDL语言，采用Top To Down的方法，实现8位数字频率计，并利用Quartus Ⅱ集成开发环境进行编辑、综合、波形仿真、并下载到FPGA器件中，经实际电路测试，该系统性能可靠。
关键词： 硬件描述语言 、现场可编程门阵列 、频率计 、频率测量
毕业设计说明书目录
1. 引言------------------------------------------------------------14
2. 方案论证--------------------------------------------------------14
2.1方案一：采用单片机进行测频控制--------------------------------14
2.2方案二：采用现场可编程门阵列(FPGA)为控制核心-----------------16
2.3方案的选择---------------------------------------------------18
2.4本章小结-----------------------------------------------------19
3. 硬件电路设计------------------------------------------------19
3.1顶层电路设计-------------------------------------------------19
3.2功能模块设计-------------------------------------------------20
3.3电源电路设计-------------------------------------------------27
3.4输入信号整形模块设计-----------------------------------------28
3.5本章小结-----------------------------------------------------28
4. 软件设计--------------------------------------------------------28
4.1程序流程-----------------------------------------------------28
4.2程序---------------------------------------------------------29
4.3本章小结-----------------------------------------------------32
5．软硬件系统的调试------------------------------------------------32
5.1测试的环境---------------------------------------------------32
5.2调试和器件编-------------------------------------------------33
5.3软硬件测试---------------------------------------------------33
5.4本章小结-----------------------------------------------------34
6．参考文献---------------------------------------------------------34
参考文献
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