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:sj52abcd基于EDA序列检测器设计
摘要: 用VHDL语言在CPLD器件上实现了一种多路脉冲序列信号检测器，能够用七段数码管实时显示各路已检测出序列信号数目，电路各摸块用VHDL语言来描述。文章介绍了仿真信号的形成原理和电路设计方法，并给出了部分电路和仿真波形。整个多路脉冲序列信号检测器设计在一块CPLD芯片上，与其他方法设计的序列信号检测器相比，具有体积小、可靠性高、功牦低的特点。由于采用模块化的设计，对功能的修改和增加只要修改VHDL源程序，而不必更改硬件电路，从而实现数字系统硬件的软件化。
关键词：EDA 序列检测器 VHDL 状态机
毕业设计说明书目录
1 引言…………………………………………………………………………………17
2 方案简介……………………………………………………………………………18
2．1方案一：基于数字电路设计简介…………………………………………18
2．2方案二：基于EDA有限状态计设计简介………………………………19
3．各模块设计和论证………………………………………………………………21
3．1．1 方案一…………………………………………………………………21
3．1．2 方案二 ………………………………………………………………26
3.1.3方案一与方案二的比较…………………………………………………30
4. 软件设计……………………………………………………………………………32
4．1程序流程……………………………………………………………………32
4．2程序…………………………………………………………………………33
5．软硬件系统的调试………………………………………………………………34
6． 附录………………………………………………………………………………40
7．参考文献……………………………………………………………………………42
参考文献
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